数字IC后端实现40天速成篇(上)
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1 技术咨询(包括技术问题咨询) tapeout review 等）
支持个人和公司的项目技术支持。
2 (承接范围从综合到 GDSII out）
小编拥有近 11 年数字 IC 后端实现经验，精通数字 Top，高性能 CPU，实现了复杂时钟结构的设计。 tapeout 过 40 颗 芯片，面积最大为 150mm2。
涉及的主要过程有等工艺。
3 IC 后端训练营
提供和公司给学生实际操作，每天及时回答所有学生当天的所有难题。如果你在实践中遇到问题，你也可以申请登录服务器共同解决实际项目问题。
对于想转行的应届毕业生或学生，可以通过这个训练营学习实战，一个月左右就能拿到理想的 offer。
4 知识星球高端技术学习交流社区
5 （仅数字 IC 后端实现方向，可提供先进的工艺库和项目数据)
提供四核 A7 可根据需要选择顶层低功耗设计，实现数据和指导 TSMC 28 或 TSMC16 等先进工艺(也可以支持) 7nm 工艺)。学生可以根据这个项目发表论文，提供技术和写作指导。
下面直接进入今天的主题。今天小编带大家再来盘点一下数字 IC 后端应该学什么，一个月内能快速入门吗？
答案显然是。今天我们先从数字后端开始 PR 从角度全面分析应该掌握什么。
当数字 IC 后端工程师得到综合后和之后，需要设计 netlist 和 constraint 读进来，创建一个 database 中去。因为工具保存数据有自己的一套。 library 的管理方式，方便存储设计相关的东西。
数字 IC 实现后端设计的过程 initial design
这里的 netlist 其实就是一个设计的电路图，只不过它是以 netlist 呈现形式。constraint 是设计约束文件，告诉工具 timing 相关的 spec 要求，让工具根据这样的约束条件进行优化。其主要成分如下：
1 create_clock&create_generated_clock
定义设计中每个寄存器的时钟工作频率
2 input &output delay
设置 IO 端口的 delay 值的目的是优化内部逻辑 path
3 set_clock_group
设置时钟同步异步关系
4 timing exception
这主要是指设置 false path，multicycle path，disable timing arc 等 timing exception。
让工具认出来 netlist 各种标准单元和 macro，我们需要指定设计中使用的所有标准单库和 macro 库，即(标准单元 Milkyway）和。
为了使工具知道如何根据一定的绕线规则放置标准单元和绕线工作，我们还需要指定工艺 tech lef（tech file）。这个
由于 PR 计算工具的每个阶段 timing，然后就要做了 RC 抽取，因此，我们还需要读入 QRC 文件（tluplus 文件）。
为了让工具在优化过程中看到更多 view 或 scenario，我们还需要配置 mcmm 文件。比如我们的训练营项目 T28, 我们在 PR flow 加两个 view，分别是 cortexa7_view_cmax 和 cortexa7_view_cmin。前者用于优化 setup 的 timing，后者用于做用。
在这里，即使所有的设计导入都完成了。有关设计导入的更多细节，请参阅以下主题共享。如果您有任何问题，您可以进一步提问和交流。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lZR3gz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「Design Import 专题」
Floorplan 工作就是摆放 macro 和 port。Powerplan 创建标准单位和 macro 供电网络的目的是让一切 device 工作电压正常。
许多初学者可能会怀疑为什么工具不能自己放置 macro 和 port 主要原因如下：
1 工具摆放 macro 位置是随机的，大概率不是我们想要的。
2 对于 block level 的 io port 放置位置由顶层指定，工具不能随意放置。随意放置后和 top 不能拼接。
1 macro 尽量放置在周围(尽量放置) core 区域的利弊是什么？
2 macro 摆放要
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3l3bnoz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「A7 data flow 后端教程」
3 有直接互动 macro 要摆放在一起，减少线长
4 macro 间的 channel 要预留好
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lJ9yrz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「macro channel 间距计算教程」
摆放 io port 的脚本及 GUI 接口操作方法见以下专题分享。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3l3qe9z31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「Innovus /ICC2 摆放 pin 步骤」
我们知道金属 metal 电阻越高，层次越高 metal，电阻值越小 powerplan 这一步是给所有标准单位和 macro 创建最小电阻供电网络。只有这样，我们才能确保我们足够好。
IR Drop 分析之 Redhawk 分析流程
数字 IC 设计后端实现前期预防 IR Drop 的方法汇总
因此，在我们的训练营中，我们使用它 M8 和 M9 最为主 powerplan 的 mesh，然后通过 M8 再打孔到 rail 上。
当然，为了保证我们的实际项目 ir drop 足够好，。因为 powerplan 绕线资源越密，占用的时钟和信号的绕线资源就越少。
以下主题是训练营项目案例，主要目的是调查 powerplan 密度对绕线资源的影响。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lZBaoz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「分享一个 powerplan 影响绕线资源的案例(面试可以分享这个过程)」
关于 powerplan 详细规划教程，可以查下面这个专题分享。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3l3Er5z31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「A7 powerplan 教程」
在这个阶段，我们还需要加入一些列的，比如 tapcell，endcap cell 以及 decap cell 等等。关于常用 physical only cell 的介绍，可以看下面这个专题分享。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3l30Prz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「physical only cell 介绍」
做完 floorplan 和 powerplan 后，我们就需要做 powerplan 的连接性检查，
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lJp95z31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「每个阶段跑完到底要检查哪些东西？」
这个阶段的工作就是，使得我们的都能满足设计需求。
这里的 timing 不仅仅指 setup，hold，removal 和 recovery，它还包含 timing drc，比如 max transition,max capacitiance，max fanout 等参数。
数字后端实现 place 过程进阶
想要彻底掌握 placement 各种技巧，这个一定可以如你所愿！
Place_opt 步骤详细解析（另附两周年活动中奖名单）
这个阶段仅需要一个命令就可以跑完。跑完 place 不是就结束了，而仅仅刚刚开始。我们需要根据产生的一系列 report 来我们的需求。
关于跑完每个阶段，工程师到底应该看哪些 report，这里小编写了一个专题分享，感兴趣的可以参考下。初学者，可以无脑照搬即可。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lJp95z31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「每个阶段跑完到底要检查哪些东西？」
为了让大家能看懂 timing report，小编又编制了手把手教你看懂 timing report 的教程。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lPRnKz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「Timing report 到底该怎么看？」
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lgDRxz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「setup 和 hold 基本概念及计算公式（校招必备）」
为了让大家能把 timing report 对应到 layout 上，让大家有个更直观的感受，特地编写了一份无脑的 highlight timing path 的专题教程。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lPLP9z31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「两个工具 highlight timing path 的方法」
如果发现 placement 后的 timing report 不是很好，那这里又提供了常用优化 timing 的几种方法。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lqEWRz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「优化 Timing 方法之 path group 和 region 用法」
如果发现 placement 后存在 local congestion 问题，还可以参考下面这个专题分享来来解决 congestion 问题。
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3l9Ey9z31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「Module &Instance Padding」
为了更好理解工具的行为，我们还需要对 place 的所有子步骤子过程进行一个全面的了解。因此，小编特地编写了一份工具
https://alidocs.dingtalk.com/i/team/QqWXw0n4YVY3gm31/docs/QqWXwVg3lqoagz31?corpId=dingcd9df953ab4a15574ac5d6980864d335# 「ICC2&innovus log 解读」
到此为止，placement 这个过程的内容我们也都有了。如果你是初学者，你就按照这个来掌握，不会的直接给我背下来，然后再慢慢理解。如果你能做到这个程度，找工作肯定是小意思了。
限于篇幅，今天就介绍到 placement 这里了，下一期我们继续从时钟树综合讲起，一直会讲解到 timing signoff 和 physical signoff（timing,drc&lvs 均 clean)。
好了，今天的内容分享就到这里。另外，因为公众号更改推送规则，小编分享的每篇干货不一定能及时推送给各位。为了避免错过精彩内容，请关注星标公众号，点击 “在看”，点赞并分享到朋友圈，让推送算法知道你是社区的老铁，这样就不会错过任何精彩内容了。
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在这里，目前已经规划并正着手做的事情：
- ICC/ICC2 lab 的编写
- 基于 ARM 四核 CPU 数字后端 Hierarchical Flow 实现教程
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