基于课程设计DAC0832单缓冲波形发生器.doc
成绩
课程论文
题 目:基于DAC0832单缓冲工作波形发生器
学生姓名：
学生学号：
系：电子工程学院
专业：通信工程
年级：2014
任课教师：
基于DAC0832单缓冲波形发生器
一、设计要求
使用DAC0832芯片，DAC0832是8分辨率的D/A与微处理器完全转换集成芯片 兼容。这个DA芯片在单片机应用中具有价格低、接口简单、转换控制方便等优点 广泛应用于系统中。D/A转换器由8位输入锁存器DAC寄存器、8位D/A 由转换电路和转换控制电路组成。利用DAC波形发牛器是0832单缓冲工作模式。
二、设计方案
本设计主要通过控制89来控制C控制51单片机的引脚DAC0832芯片 芯片作为控制部分，单片机中断源丰富，精度高，C语言灵活， 单片机I/O功能强大，易于扩展，使设计更加完善。
由于本设计的传输距离不远，使用I/O 口不多，平行通信可以满足课程设计 充分发挥其优点，电路简单，易于控制。
AT89C51
AT89C51是种带4K可编程的字节闪存可以擦除只读存储器FPEROM的低电压, 高性能C0MS8位微处理器，俗称单片机，ATMEL的AT89C541高效微 控制器,AT89C51单片机为许多嵌入式控制系统提供了灵活、高、便宜的解决方案。
AT89C51提供以下标准功能：4k字节Flash闪速存储器，128字节内部RAM, 32个I/O 口线，两个16位定时/计数器，一个5向量两级中断结构，一个全双工 串行通信口、片内振荡器和寸钟电路。同时，AT89C51可降至OHz静态逻辑操 支持两种软件可选的节电工作模式。停止空闲CPU但是允许 RAM,定时/计数器，串行通信口和中断系统继续工作。保存掉电方式RAM中的 但在下一个硬件复位之前，振荡器停止工作，并禁止所有其他部件工作。
此外，AT89C51具有稳态逻辑，在低到零频率的情况下可以支持静态逻辑 两种软件可选的断电模式。在闲置模式下，CPU停止工作RAM,定时器， 计数器、串口和中断系统仍在工作。保存在断电模式下RAM并冻结内容 在下一个硕士复位之前，禁止使用其他芯片进行振荡器工作。
LJ.lXTAL1P0.0/AD0XTAL2P0.1/AD1P0.2/AD2P0.3/AD3RSTP0.4/AD4P0.5/AD5P0.6/AD6P0.7/AD7PSENP2.0/A8
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XTAL1
P0.0/AD0
XTAL2
P0.1/AD1
P0.2/AD2
P0.3/AD3
RST
P0.4/AD4
P0.5/AD5
P0.6/AD6
P0.7/AD7
PSEN
P2.0/A8
P2.1/A9 P2.2/A10 P2.3/A11
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AT89C51引脚图
VCC：供电电压GND：接地
P0 口： P0 8个漏极开路双向I/O 每脚可吸收8口TTL门电流。当P0 口 的管脚第一次写1时，被定义为高阻输入。P0可用于外部程序数据存储词。
P1 口： P1 提供内部上拉电阻的8位双向端口I/O 口，P1 口腔缓冲器可接收输出 4TTL门电流。P1 口管脚写入1后，内部上拉为高，可作为输入，P1 口被外部下 由于内部上拉，拉为低屯平时会输出屯流。
P2 口： P2 8位双向口为内部上拉电阻I/O 口，P2 可接收口缓冲器，输出4个 TTL门电流，当P2 当口腔被写为1时，管脚被内部上拉电阻拉高，并作为输入。 因此，作为输入，P2 管脚被外部拉下，输出电流。这是由于内部上拉。
P2 当用于存取外部程序存储器或16位地址的外部数据存储器时，P2 口输岀地址 高八位。当给出地址1时，它利用内部上拉数据存储时，部八位地址数据 器进行读写时，P2 口输出其特殊功能寄存器的内容。P2 口在FLASH编程和校准 接收高八位地址信号和控制信号。
P3 口： P3 口管脚是8个带内部上拉电阻的双向I/O 口，可接收4个输出TTL门电流。 当P3 口写入1后，它们被内部拉到高电平，