总结数字电子技术的基本知识点,包括练习!
- 第一章,数制和码制
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- 一、常用数制及其转换
- 二、转换不同数量的系统
- 三、二进制算术运算
- 四、几种常用编码
- 五、部分练习及总结
- 第二章是逻辑代数基础
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- 一、三种基本操作
- 二、逻辑代数的基本公式
- 三、逻辑代数的基本定理
- 四、逻辑函数及其描述方法
- 五、逻辑函数的简化方法
- 六、具有无关项逻辑函数的简化方法
- 七、部分练习及总结
- 第三章,门电路
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- 一、 概述
- 二、 半导体二极管
- 三、CMOS门电路
- 四、 TTL门电路
- 第四章组合逻辑电路
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- 一、概述
- 二、二。逻辑电路分析方法的组合
- 三、组合逻辑电路的基本设计方法
- 四、常用的组合逻辑电路模块
- 五、组合逻辑电路中的竞争-冒险
- 六、部分练习及总结
- 第五章半导体存储电路
- 第六章时序逻辑电路
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- 一、概述
- 二、时序逻辑电路分类
- 三、时序逻辑电路分析方法
- 四、一些常用的时序逻辑电路
- 五、时序逻辑电路的设计方法
- 六、部分练习和总结
- 第七章,脉冲波形的产生和整形电路
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- 一、施密特触发电路
- 二、单稳态电路
- 三、多谐振荡电路
- 四、555定时器及其应用
- 第八章,数-模和模-数转换
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- 一、D/A转换器的电路结构和工作原理
- 二、D/A转换器的转换精度和速度
- 三、A/D转换器的电路结构和工作原理
- 四、取样-保持电路
- 五、A/D转换器的转换精度和速度
最近重新学习了数字电子技术的基础,知识点很多,读者边学边整理。如果文章中有错误,请纠正! 教材为阎石老师版,第六版,全文按教材顺序进行。 如若想系统学习,这边建议B站或慕课,清华大学王红老师主讲版本或者电子科技大学版本。
第一章,数制和码制
一、常用数制及其转换
- 二进制(B)
比如:(1111)=15(十进制)
- 十进制(D)
比如:19=10011(二进制)
- 八进制(O)
比如:12=10(十进制)
- 十六进制(H)
比如:2A=42(十进制)
二、转换不同数量的系统
- 二进制转其他进制
- 十进制转其他进制
- 八进制转其他进制
八进制其它非二进制时需要化为十进制,再从十进制出发转换为其它进制,方法与上面的例题同。
- 十六进制转其他进制
十六进制转为其它进制时思想与八进制同。
三、二进制算术运算
- 原码、反码、补码的概念
*原码:添加符号位,1表示负数,0表示正数(如 1000=01000;-1000=11000) *反码:正数反码与原码相同,负数除去符号位(如(-1000)=10111) *补码:正数和原码一样,负数加1(如(-1000)=11000)
- 减法运算
例: 1101-1011
3. 加法运算
例:1010 0011
四、几种常用编码
- 常见的十进制编码
br>
- 格雷码
五、部分习题及小结
第二章、逻辑代数基础
一、三种基本运算
- 与运算
- 或运算
- 非运算
*
- 与非
Y=(AB)‘=(A’+B’)
- 或非
Y=(A+B)‘=A’B’
- 与或非
Y=(AB+CD)’
- 异或
Y=A’B+AB’
- 同或
Y=AB+A’B’
二、逻辑代数的基本公式
1.基本公式
- 常用公式
三、逻辑代数的基本定理
- 代入定理
在任何一个包含变量A的逻辑等式中,若以另外一个逻辑式代入式中所有A的位置,则等式成立。简单来讲,就是只要我代替了你这个等式中所有的A,那么代替A后的这个等式也是成立的。
- 反演定理
对于任意一个逻辑式Y,若将其所有的“.”换成“+”,“+”换成“.”,0换成1,1换成0,原变量换成反变量,反变量换成原变量,则得到的结果就是Y’。 如Y=A(B+C)+CD 则Y’=(A’+B’C’)(C’+D’) 即乘换成加,加换成乘,原边反,反边原。
- 对偶定理
对于任意一个逻辑式Y,若将其所有的“.”换成“+”,“+”换成“.”,0换成1,1换成0,则得到的一个新的逻辑式就是Y(D这个D在右上角,我打不上去,只好搁在这里)。 如:Y=A(B+C) 则Y(D)=A+BC
四、逻辑函数及其描述方法
输入与输出之间对应的一种函数关系,记作Y=F(A,B,…),比如只要我知道ABC…的状态(0或1)我就可以唯一确定Y。
- 逻辑真值表
部分截图,也就是ABC的输入对应着Y的输出。
2.逻辑函数式
比如:Y=A(B+C)
3.逻辑图
利用前面所学的与或非的关系,根据Y=ABC或其它式子画出对应的逻辑图。 此图为Y=A(B+C)的逻辑图
4.波形图(了解即可)
5、各种描述方法间的相互转换
其中0代表着非,1与0恰好相反,比如此图中Y=A’B’C’+A’BC+AB’C+ABC’(Y的输出为1的需要写出来,为0的则不需要写出来)
它为逻辑表达式Y=(A+B’C)‘+A’BC’+C的逻辑图!
也就是ABC的状态与Y一一对应
6、最小项
比如0010可以记作m2 比如1000可以记作m8 再比如:
五、逻辑函数的化简方法
1.公式化化简
并项法:AB+AB’=A(B+B’)=A 吸收法:A+AB=A(1+B)=A 消项法:AB+A’C+BC=AB+A’C+BC(A+A’)=AB+A’C+ABC+A’BC=AB(1+C)+A’C(1+B)=AB+A’C 消因子法:A+A’B=(A+A’)(A+B)=A+B 配项法:利用A+A=A或A+A’=1的原则
2.卡诺图化简
原则很多,然后打字讲解缺少感觉,最好的方法是自己做题化简,要是有问题可以评论区留言一起解决。
六、具有无关项逻辑函数的化简方法
原则是X可以作为1来化简,圈出来得圈尽可能的包含更多的1。
七、部分习题及小结
第三章、门电路
因为门电路更多的涉及的知识是模电的知识点,所以此处考点不会很多,也复习的比较浅薄,只是复习了一些概念性名词,没有深入考究。
一、 概述
用以实现基本逻辑运算和复合逻辑运算的单元电路成为门电路。 可以将数字集成电路划分为小规模集成电路(SSI)、中规模集成电路(MSI)、大规模集成电路(MSI)、超大规模集成电路(YLSI)和甚大规模集成电路(ULSI)。 根据所用半导体器件不同分为TTL电路和MOS电路。
二、 半导体二极管
三、CMOS门电路
CMOS电路优点是功耗低,适合制作大规模集成电路。 MOS管有四种类型:N沟道增强型
P沟道增强型
N沟道耗尽型和P沟道耗尽型
四、 TTL门电路
TTL门电路中有一个OC门(集电极开路输出结构)需要了解。 OC的应用:实现线与结构;电平转换;驱动显示器件和执行机构。
第四章、组合逻辑电路
一、概述
根据逻辑功能的不同特点,可以将数字电路分为两大类,一类为组合逻辑电路,一类为时序逻辑电路,前者不具有记忆功能,也就是任何时刻的输出仅仅取决于该时刻的输入,与电路原来的状态无关,即电路中不包含存储单元;而时序逻辑电路具有记忆功能,这是与组合逻辑电路最不同的一点。
二、组合逻辑电路的分析方法
从电路的输入到输出逐级写出逻辑函数式,得到Y 利用公式法或者卡诺图化简法进行化简 可以转换为真值表的形式
三、组合逻辑电路的基本设计方法
进行逻辑抽象 写出逻辑函数式 选定器件类型 将逻辑函数化简或转换成适当的描述形式 根据化简或转换后的逻辑式,画出逻辑电路的连接图
四、常用的组合逻辑电路模块
编码器的功能就是将输入的每一个高、低电平信号编成一个对应的二进制代码。其本质就是赋予二进制代码特定含义的过程, >
- 3-8线集成优先编码器
其中小圆圈代表该管低电平有效!S’为选通输入端,只有在S’=0的条件下,编码器才能正常工作。而在S’=1时,所有的输出端均被锁在高电平。 其真值表如上图,注意,输出端Y均为反码输出! 后面还有一个二=十进制编码器74HC147,这个了解即可。
3、译码器
将每个输入的二进制代码译成对应的输出高、低电平信号或另外一个代码,因此,译码是编码的反操作。常用的译码器有二进制译码器、二-十进制译码器和显示译码器三类。
与非门3线-8线译码器74HC138(CMOS门电路组成,低电平有效!必须掌握!) 其中,S1为1,S2’+S3’=0时,译码器处于工作状态;否则,译码器被禁止,所有输出端被封锁在高电平。
二-十进制译码器74HC42(低电平有效!具有拒绝伪码功能!)
显示译码器(七段字符显示译码器) 常见的七段字符显示译码器有半导体数码管和液晶显示器两种,其中需要掌握的是前者! 因为这种数码管的每个线段都是一个发光二极管,所以也称为LED数码管或LED七段显示译码器!其为了增加使用的灵活性,同一规格的数码管一般都有共阴极和共阳极两种类型可以供选用。 半导体数码管优点有:工作电压低、体积小、寿命长、可靠性高、响应时间短、亮度较高。 半导体数码管缺点:工作电流比较大。
4、数据选择器
从一组输入数据中选出特定的数据。
二选一选择器(最小的选择器,了解即可)
四选一选择器(74LS153) 其中A1和A0为两位输入地址,Y为一个输出数据,E为一个输入控制(低电平有效),D0D1D2D3为四路输入数据(这里可以发现数据选择器输入数据不考虑有效方式)。
双四选一数据选择器74HC153 原理和4选1选择器一样,S2和S1接低电平有效,A1A0为两位输入地址,Y2和Y1为输出,D为输入数据,与之不同的一点就是双4选1选择器内部有两个相同的4选1选择器的单元的模块。
八选一选择器(74HC151)
5、加法器
比如说1001和0111相加,图中(1)这个位置也就是1和1相加后向它的高位也就是(2)进了1,(1)这里并没有考虑低位的进位(直接相加),而在(2)这个位置,它考虑了(1)位置的进位1,后面的(3)位置或者更高位也都要考虑来自低位的进位,所以我们把不考虑低位的进位实现半加运算的电路称为半加器,把考虑低位进位的称为全加器。
1位加法器
半加器:不考虑来自低位的进位而将两个1位二进制数相加。实现半加运算的电路称为半加器。 从真值表可以看出S=A’B+AB’;CO=AB;(所以半加器由一个异或门和一个与门组成。)这里的S是相加后本位的结果,而CO是相加后本位向高位的进位。 >
全加器:除去最低位外,每一位都考虑来自低位的进位。 即两个对应位的加数和雷子低位的3个数相加。所用电路称为全加器。其中CI为低位向本位的进位,S为相加后本位的结果,CO为本位向高位的进位。
多位加法器(了解即可) 分为串行进位加法器和超前进位加法器。如有需要深入学习,可以去看课本。
6、数值比较器
作用如其名,就是用来比较两个数值的大小。两个数比较大小,一定有三种结果,大于、等于和小于。
1位数值比较器 > 多位数值比较器 比较两个多位数的大小时,必须自高而低逐位比较,只有在高位相等时,才需要比较低位。比如ABC和DEF,首先比较A和D,如果A>D,那么ABC>DEF,如果A=B,则需进行B和E的比较,反之,若A<D,则ABC<DEF。
五、组合逻辑电路中的竞争-冒险
- 竞争
在组合逻辑电路中,当某一个变量经过两条以上路径到达输出端时,由于每条路径上的延迟时间的不同,到达终点的时间有先后,这一现象称为竞争。(输入级)
- 冒险
由于竞争使电路的输出端出现了稳态下没有的干扰脉冲(毛刺)的现象称为冒险。(输出级)
- 竞争-冒险
由于竞争而在电路输出端可能产生尖峰脉冲的现象称为竞争-冒险。可以这样理解,本来最终结果应该都为0的,但是出现了一小段的1(也就是出现了本不该在理论设计中出现的脉冲干扰信号)。
只要输出端的逻辑函数在一定条件下可以简化为Y=A+A’或Y=AA’,则可判定存在竞争-冒险现象。 比如某个电路输出逻辑函数表达式为Y=AB+A’C,此时判断它是否存在竞争-冒险现象,不可以对表达式进行化简,观察有没有一个变量同时出现了原状态和非状态,然后保持这个变量不变,其它变量取0和1的组合,例如:当B=C=1时,上式将成为Y=A+A’,也就是存在竞争冒险现象。
接入滤波电容 引入选通脉冲 修改逻辑设计
六、部分习题及小结
【
这道题要注意的一点是以Y为分界线(分为Y上半部分和Y下半部分,同一区域之间是或的关系,而不同区域之间是与的关系,比如接通1000后Y输出端表达式为A+B,而接通1001时则变为了(A+B)(A’+B’)=AB’+A’B。 】
【
这道题要注意的一点是水面高于检测元件,输出低电平(0),低于检测元件输出高电平(1) 】
【这道题要注意的一点是,S接入的是P端,Y1和Y2分别对应着P’和P】
【补充,本章需要掌握的器件图如下:】
第五章、半导体存储电路
一、 概述
时序逻辑电路具有记忆功能。 存储单元:只能存储一位数据的电路 寄存器:用于存储一组数据的存储电路 存储器:用于存储大量数据的存储电路
二、SR锁存器
锁存器:寄存一位二值代码,通常由两个或非门或者与非门组成。
三、触发器
与锁存器相比, 除去置1和置0外,又增加了一个触发信号CLOCK输入端(记作CLK)。
触发信号的工作方式可以分外三类 :电平触发、边沿触发和脉冲触发三种。根据电路内部结构形式 :基本触发器(没有CLOCK信号),同步触发器,主从触发器,维持阻塞触发器,CMOS边沿触发器。根据逻辑功能 :RS触发器,JK触发器,D触发器,T和T’触发器。根据存储数据原理 :静态触发器、动态触发器。 其中静态触发器是靠电路状态的自锁存储数据,而动态触发器是通过MOS管栅极输入电容上存储电荷束存储数据的。
四、 按逻辑功能触发器的分类
补充! 【其中JK触发器和D触发器最重要,且JK触发器可以转换为RS触发器或者T触发器】 【比如在需要SR触发器时,只要将JK触发器的J、K端当作S、R端使用,即可实现SR触发器的功能;在需要T触发器时,只要将J、K连在一起当作T端使用,就可以实现T触发器的功能(利用了特性方程的思想,即对于JK触发器的特性方程为Q=JQ’+K’Q,当J=K=T时,Q=TQ’+T’Q,这样一来就变为了T触发器的特性方程,实现了从JK触发器转变为T触发器这一变化) 】
SR触发器(置0置1触发器) 特性方程:Q✳=S+R’Q; SR=0 特性表:(其中:前一二行功能为保持,三四行为置0,五六行为置1,七八行为不定) 【补充:如何看待置1和置0的功能? 我们把Q称为初态,Q✳称为次态,从初态到次态的变化代表了相应的功能,比如下面SR触发器中前两行,Q分别从01变为对应的Q*的01,也就是状态并没有发生变化,我们称它的功能为保持,后面的依次类推即可。】状态转换图:
JK触发器(置1和置0翻转触发器) 特性方程:A✳=JQ’+K’Q 特性表(最后两行体现了翻转功能) 状态转换图:
T触发器(翻转触发器) 特性方程:Q✳=TQ’+T’Q 特性表 状态转换图
D触发器(跟随触发器) 特性方程:Q✳=D 特性表 状态转换图
五、 寄存器
寄存一组二值代码。
六、存储器
存储大量二值信息的器件。
存储器容量的扩展:位扩展方式和子扩展方式。256*8的 芯片,其中256为字数,8为位数。举例说明: 例1 、 用1M4的SRAM芯片设计一个1M8的SRAM存储器,则需要多少1M4的芯片多少片?(位扩展) 答:所需芯片数为:(1M8)/(1M4)=2(片)例2 、用256K8位的SRAM芯片设计2048K8位的存储器,需要多少片?(字扩展) 答:所需芯片数:(2048K8)/(256K*8)=8片字位扩展:如若字数和位数都发生变化,方法一致,即d(所需芯片数)=设计要求的存储容量/已知芯片存储容量
七、部分习题及小结
【输出端波形图的高电平和低电平要和输入端相对应,比如SD’为高电平,RD’为低电平时,Q对应着低电平,Q’对应着高电平。依次类推。】
第六章、时序逻辑电路
一、概述
任一时刻的输出信号不仅取决于当时的输入信号,而且还取决于电路原来的状态,或者说,还与以前的输入有关。区别于组合逻辑电路。 时序逻辑电路通常包括组合电路和存储电路两个组成部分,而存储电路是必不可少的;存储电路的输出状态必须反馈到组合电路的输入端,与输入信号一起,共同决定组合逻辑电路的输出。
二、时序逻辑电路的分类
根据电路的工作方式即电路中触发器的工作时刻是否统一来进行划分: 同步时序逻辑电路(统一);异步时序逻辑电路(不统一)
根据电路输出信号的关系来划分(即电路的输出函数): 米里型:输出信号由输入变量和现态共同决定。 莫尔型:输出信号只与电路的现态有关。
三、时序逻辑电路的分析方法
同步时序逻辑电路的分析方法: 1、写出驱动方程 看图写方程,必须多加练习,掌握。
2、把驱动方程带入特性方程得到状态方程 判断使用的是哪种类型的触发器(一般是SR触发器、JK触发器、T触发器和D触发器,带入对应的触发器的特性方程)
3、写出输出方程 这一步也可以提前写,直接写出Y即可。从图中可以直接得到。
4、根据状态方程得到状态转换方程,画出状态转换图 其实这里可以简画一下状态转换表,根据状态转换表写出状态转换图,也可以直接代入状态转换方程写出状态转换图。
5、依据状态转换表说出该电路的功能 一般来讲,根据画出的状态转换图或者状态转换表就可以观察出该电路可以实现哪些功能,后续有例题可以练习。
6、检查有没有自驱动(也叫自启动)功能 如何判断有没有自驱动能力只需要两步,第一步是看这个状态转换图是否有闭环,如果没有闭环,则不能自驱动,如果有闭环,则再看所有的闭环是否在一个图中,比如有两个闭环,但是这两个闭环没有交际,那么也不具备自驱动能力,专业点来说就是无效状态没有形成自己的闭环的同时,有效状态形成了自己的闭环就具备自启动能力。【具有自启动能力】 【不具有自启动能力】
【例一】
四、若干常用的时序逻辑电路
- 寄存器
用于完成寄存功能,存储二进制数据和代码的电路。寄存器以触发器为核心单元,而一个触发器能寄存一位二进制代码;有并行和串行方式。
- 寄存器的分类
普通寄存器 完成对并行输入数据的存储,数据也只能并行输出,形成并行输入、并行输出的传输结构;存储单元采用基本触发器、边沿触发器和同步触发器,这三者皆可构成。 一般使用JK触发器或者D触发器进行对输入数据的存储。74LS175基本寄存器
移位寄存器 移位寄存器除了具有存储代码的功能外,还具有移位功能。所谓移位功能,是指寄存器里存储的代码能在移外脉冲的作用下依次左移或右移。因此,移位寄存器不但可以用来寄存代码,还可以用来实现数据的串行-并行转换、数值的运算和数据处理等,具有灵活的传输数据结构, 但是存储单元只能用边沿触发器构成 。
单向移位寄存器 4位右移寄存器 从图中可以看出,假设输入数据为1011,那么首先1先进入到D0,然后原来D0存储的数据进入到D1,依次类推,第二个1进入,原先D0中的1进入到D1,依次往后,直到1011全部输入完,如果此时D0存储为1,D1存储为0,D2和D3依次为11,如果没有时钟脉冲,那么输出端就会是1011,如果再来一个时钟脉冲,那么会继续往右边移动。4位左移寄存器 左移寄存器是D3作为第一个输入,原理和右移寄存器一样。
双向移位寄存器 既可以左移又可以右移的寄存器。增加了一个M端用来控制是左移还是右移,M取0或1。4位双向移位寄存器74LS194 其中有两个符号比较特殊:DSR和DSL,其实是用来控制左移还是右移,S指英文单词signal,那对应的R和L就是right 和left(即左边和右边)。 从下面这张功能表可以看出,M0M1就是工作方式控制端,当M1M0为01时,右移;M1M0为10时左移,且都在时钟脉冲上升沿工作。
数字系统中使用的最多的时序电路,不仅能用于对时钟脉冲计数,还可以用于分频、定时、产生节拍脉冲和脉冲序列以及进行数字运算等。
同步计数器(时钟脉冲输入时触发器的翻转是同时发生的) 74LS161(4位二进制同步加法计数器) 说明: 【从74161的功能表可以看出,当CR非低有效时,无论输入怎么变化,输出均为0,所以它称为清零控制端;而当CR非为1,LD非为低有效时,输入和输出都相对应,所以LD非称之为置数控制端。】 【那同步和异步又是怎么判断的?首先看清零控制端,当它低有效时,无论其它输入怎么变化,输出均为0,所以它被称之为异步清零,也叫做直接清零;而对于第二行,LD非为0时还需要借助一个CLK上升沿脉冲,才能达到置数的目的,所以称之为同步置数,也就是没有CLK“我”不能独自完成任务,所以它也被称之为间接置数。】 【当EP和ET同时高有效时,完成上升沿工作,实现计数功能。不清零不置数时则保持,CO为进位输出端。其中的优先顺序:清零>置数>计数】
74LS163(和74LS161很像,但是有细微差别) 74LS163的清零方式是同步清零!!!而非异步清零,其余没有差异。
74LS160(十进制同步加法计数器) 与前面161163不同的是74LS160EPET高有效时的输出是十进制加法计数(也就是从0000到1001)。
异步计数器(触发器的翻转有先有后,不是同时发生的) 异步二进制计数器
- 两种方法
置零法(也叫清零法):0000是工作循环的起点,也就是实现几进制计数功能,工作循环处状态必须从0开始; 置数法:工作循环的起点可以任意选择,可以从0001或者0010或者其它开始,但是一定要在置数数据输入端输入才可。
假定已有的是N进制计数器,而需要得到的是M进制计数器。这时有M<N和M>N两种可能的情况。 步骤: 1、选用的计数器芯片的状态迁移顺序要符合设计目标的要求 2、正确消除无需利用的其它功能的影响(比如选择置数时,让RC非接1) 3、正确为芯片的计数控制端接入有效信号 4、注意二进制计数器芯片和十进制计数器芯片的技术进制的差异
异步清零:终止于工作循环终点的下一个状态生成控制信号; 同步清零:终止于工作循环状态生成控制信号; 举例:比如利用74LS190分别用异步清零法和同步清零法实现7进制计数。 则同步清零是从0000到0110;而异步清零是从0000到1000(为什么会多出一个状态,原因在于异步清零它不借助于时钟信号,一旦CR非低有效时直接清零,如果到达0110时CR非低有效,那么0110直接清零后实现的其实是从0000到0101也就是一个六进制计数,而不是七进制计数了)
五、时序逻辑电路的设计方法
1、逻辑抽象,得出电路的状态转换图或状态转换表 2、状态化简 3、状态分配 4、选定触发器的类型,求出电路的状态方程、驱动方程和输出方程 5、根据得出的方程式画出逻辑图 6、检查设计的电路能否自启动 【例题、设计一个带有进位输出端的十三进制计数器,原题在课本313页】 第一步、进行逻辑抽象,得出状态转换图(一般用这个,便于做题) 因为要设计一个十三进制的计数器,则需要四位二进制数,从0开始依次到12形成一个闭环。 第二步、状态化简和分配 根据状态转换图得到卡诺图
根据总的卡诺图得到分解的卡诺图,分别化简得到Q* 第三步、将状态方程代入JK的特性方程,即Q*=JQ’+K’Q,得到驱动方程。 第四步、根据驱动方程画出逻辑图 第五步、判断是否具有自启动能力。 很明显,电路具有自启动能力,可以把无效状态(1101、1110、1111)代入状态方程中计算得到它对应的次态分别为(0010、0010和0000),无效状态没有形成单独的闭环,它加入到了有效状态中,故可以自启动。
六、部分习题和小结
【第六章非常非常重要,必须掌握用同步或异步置数法或清零法设计进制数,74161和74163还有74160芯片的功能表得熟记,大题比较套路,原理理解之后直接可以套模板,多做练习。要想得高分,下面的习题必须全部掌握。】 【补充:时序图如何理解?】 【其实状态图的上升和下降对应着状态转换表,比如本题状态转换表虽然没有要求画出来,但是我们可以写在草稿纸上(PS:可以自己写一遍试试),比如Q1Q2从初态00变到次态10(Q1*Q2※),对应着时序图也是从00到10,然后再从初态10变到次态01,对应着时序图的变化,依次类推即可。】
【补充,可能在这里有朋友疑惑怎么得出的这个状态转换图,其实只需画一个状态转换表即可,如下:画了一个草图,也就是当Q3Q2Q1状态不同时,对应着他们的次态Q3Q2Q1(都有*号,显示不出来)状态也不同,其中Y为输出,从第一行开始,000到001,Y输出为0,然后从001到010,Y输出为0,依次类推,直到从100到000时,形成一个闭环,这时,需要重新出发,101到011依次类推,最终画完状态转换图。】*
【这里要注意的一点是可以看到74160(1)中不需要特定的数字,所以它这里的LD和RD都接入了高电平,也就是不能发挥其作用,因为LD和RD只有低电平有效,而第二个芯片74LS160(2)LD接入了低电平有效是因为我置初态为0111,使用了置数功能,所以我接入了LD低电平有效。总的来讲,就是在设计芯片实现进制时一定要重视LD和RD的连接】
【说明:可能会有朋友疑惑为什么这里是83进制计数器而不是53进制计数器?】 在此作出解释:
74161是四位二进制同步加法器,而不是十进制 ,我们从图中可以得到,第一个芯片74161从0000到1111时会向第二个芯片74161进一位(74LS161(2)为高位),也就是第二个芯片的EPET开始高有效,第二个芯片从0000变为0001,此时第一个芯片又开始从0000到1111,再进位,直到第二个芯片达到0101第一个芯片达到0010时全部清零。所以它总共进行了16*5+3=83次,也就是实现了八十三进制计数器。本质就是低位片运行一周,高位片计数一次,这也是级联扩展的思想。 】
第七章、脉冲波形的产生和整形电路
一、施密特触发电路
施密特触发器也被称之为电平触发的双稳态触发电路,是指输入、输出信号具有滞回性,并可以完成多种逻辑功能的一类集成门电路器件。
【施密特电路特点】 1、输入信号从低电平上升的过程中电路状态转换时对应的输入电平,与输入信号从高电平下降过程中对应的输入转换电平不同。 2、在电路转换时,通过电路内部的正反馈过程使输出电压波形的边沿变得很陡。
【施密特电路作用] 1、用于波形变换 2、用于脉冲鉴幅 3、用于脉冲整形。
【555定时器构成的施密特触发器】 补充:从波形图中可以看出,第一、U1也就是输入从带有干扰信号的模拟信号转变为U0输出带有二值逻辑化后的数字信号,所以实现了波形变换;第二,U1输入期间信号波浮动较大,而输出U0期间波不“陡”了,所以实现了波形整形。 【以下实现了脉冲鉴幅】
二、单稳态电路
单稳态电路特点: 1、有稳态和暂稳态两个不同的工作状态。 2、在外界触发脉冲作用下,能从稳态翻转到暂稳态,在暂稳态维持一段时间后,再自动返回稳态。 3、暂稳态维持时间的长短取决于电路本身的参数,与触发脉冲的宽度和幅度无关。
【555定时器实现单稳态电路】
三、多谐振荡电路
没有稳态,接通电源后,不需要外加触发信号,便能产生矩形脉冲。
四、555定时器及其应用
【具有低有效直接复位端(4),且有2个输入端(6高有效、2低有效)、1个输出端(3)的特殊反相器。4管脚直接复位,低有效;不复位的前提下,输出端根据有效输入激励端反相;6、2优先级看情况。】
第八章、数-模和模-数转换
D/A转换器:一般属于系统的后级电路,完成数字信号到模拟信号的转变。 A/D转换器:一般属于系统的前级电路,完成模拟信号到数字信号的转变。
一、D/A转换器的电路结构和工作原理
【转换原理】 按权值展开对位相加;输入为数字量,输出为模拟量;输出模拟电压信号实际不连续,是由一系列“台阶电压”组成,其中台阶电压的大小就是输入“00…01”所对应的模拟电压大小。
二、D/A转换器的转换精度和转换速度
【D/A转换精度】 1、分辨率 :表征DAC的理论转换精度。 2、转换误差:表示器件实际的输出模拟量和理论输出模拟量之间的偏差。转换误差是一个综合性的静态指标:通常包括比例系数误差、非线性误差、漂移误差等多个成分、这些误差的绝对值之和,就是转换误差大小。【计算分辨率】 例如8位DAC:分辨率为255(也就是2的8次方减1),或者8位
【D/A转换速度】 1、建立时间tset:从数字信号输入DAC开始,到输出端对应得到稳定的模拟信号为止,整个转换过程所需要的时间。 2、一般而言,电流输出型DAC的建立时间较短,电压输出型DAC的建立时间长一些。
[DAC的选型] 并不是任何时候都选择尽量高的技术指标,要根据实际需要确定。 1、DAC的分辨率要根据CPU的数据处理位数选择; 2、DAC的转换误差越小越好,选择高精度DAC、运放和参考电压源等,但这也意味着器件成本的提高; 3、DAC的转换速度不是越快越好,这与整个系统的时序要求有关,符合要求即可。
三、A/D转换器的电路结构和工作原理
【A/D转换原理】
四、取样-保持电路
【取样定理】 在取样间隔内完成对应的量化和编码,输出对应的数字信号。
【取样保持电路(简化版)】
五、A/D转换器的转换精度和转换速度
【转换精度】 1、分辨率:用来说明ADC对输入信号的分辨能力,可以用输出二进制或十进制数的位数表示。 2、转换误差:表示器件实际的输出数字量和理论输出数字量 之间的偏差。【计算分辨率】 1、公式:(1/2^n)*FSR(其中FSR为满量程) 2、举例:8位ADC,输入满量程5V,则转换误差为?
【转换速度】 主要取决于转换器的电路结构,不同类型的ADC的转换速度差异极大。
【ADC选型】 1、ADC的分辨率要根据CPU的数据处理位数选择; 2、ADC的转换误差,理论上当然越小越好,但这也意味着期间成本的提高,实际选型时,要根据对数据处理精度的要求,合适即可; 3、ADC的转换速度1也不是越快越好,与整个系统的时序要求有关,符合要求即可,由此可以更好地控制系统成本。