宿端示例设计在 FPGA 内部的BRAM 中实施了 EDID 数据结构。DisplayPort 源代码可以通过 AUX 通道实现
I2C 协议。图 3 和图 4 连接到源端显示 DisplayPort 宿端的方框图。宿端的方框图 Link 与 Stream
Policy Maker属于宿端内核的组成部分，但源端 LinkPolicy Maker
具有较高的复杂性，将作为源代码提供参考设计。EDID 通过I2C 接口连接到接收宿端。
I2C 协议非常适合针对 EDID 这种类型的应用常用于数据结构的连接。I2C 控制器负责定位和管理EDID
通过串行接口和 I2C 接口协议(通过 AUX 通道)将数据传输到宿端内核。在工作模式下，用户不需要知道 EDID
是否正在被访问。用户可以通过检测 I2C 总线来监控 ROM 内容。用户可以在调试模式下修改I2C 控制器，覆盖 EDID ROM
提供的 3位内容。I2C 当与适当的开集输出相连时，可以提供控制信号 I2C 主接口。
宿命名为宿命名DisplayPort
配置数据(DPCD)数据结构，可以存储和配置数据，并作为宿舍和源可读写的通信邮箱使用。跨源通常用于源端 AUX 通道的 DPCD
内容(见图 3 和图 4)。
Policy
Maker 链路调训
在 DisplayPort
在链路上建立通信的过程被称为链路培训。在链路培训过程中，核心将专注于减少通信启动中的错误，同时优化链路的速度和功耗。如果数据传输出现问题，核心将自动重复链路培训，以适应不断变化的条件。源端和宿舍端信息包之间的通信通过双向半双工
1Mbps AUX 通道进行。视频和音频数据通过主链路信道(1,2 或
4)传输是从源端到宿端的高速千兆级收发器通道。
核心的链路调整分为两个步骤：时钟恢复和信道平衡；符号锁定(symbol lock)、对准信道。步骤1，接收器 PLL
锁定进入信号，恢复链路时钟。第二步，系统优化了通道平衡和信道对准。
以下是源端和宿端 PolicyMakers 典型的工作顺序：
1. Tx Link Policy Maker 如果发现有热拔插，可以监测热拔插的检测情况 Stream Source
Policy Maker 发送通知。Stream Source Policy Maker 通过 AUC 通道读取宿端
EDID;
2. Tx Link Policy Maker 通过AUX 从自宿端读取通道
DisplayPort配置数据。根据源端和宿端的功能配置，可以是宿端 DPCD 的链路配置字段编写配置参数，并通过写入到宿端
DPCD 的“TRAINING_PATTERN_SET字节启动链路调训，然后初始化调训模式的发送；
3. Tx Link Policy Maker 根据来自 Rx Link Policy Maker
通过调整电压振幅和必要时的比特率来控制时钟恢复顺序。一旦核心完成时钟恢复，链路训练将进入通道平衡阶段。在这个阶段，如果调用
Rx LinkPolicy Maker，也就是说，调整预加重。此外，接收器还将在此阶段完成符号锁定和信道之间的对准；
4. 一旦核心通过链路训练( 即系统完成位置锁定和符号锁定) DPCD 提示。Tx Link PolicyMaker
可向 Tx Stream Policy Maker 报告调整情况，实现同步流，同时传输流属性数据。
Policy
Maker 的附加功能
除参与链路调训外，Tx Link Policy Maker 也可用于接收器IRQ HPD 信号监控宿端事件通知并可检查
DPCD 链路状态字段，了解中断的原因。Tx Link Policy
Maker如果检测到链路失去锁定，则必须重新训练链路。如果接收器被调用，链路可以重新配置，以增加或减少主链路的信道数量。
此外，Link Policy Maker 也可以决定多个 AUX
要求处理事物的顺序，因为每件事都是在另一件事开始之前处理的。因为宿舍的答案可以是 NACK或者 DEFER，Policy
Maker 这两种情况的后续工作必须决定。AUX 事物处理于 16 所以字节数据Policy Maker
必须将较大的事务处理分为多个不超过 16 处理字节事物。
由于 DisplayPort 能够协商和优化链路设置，从而在不断变化的条件下实现结果。Link 与 Stream Policy
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Policy Maker Controller
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